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CY7C1361C
CY7C1363C
Document #: 38-05541 Rev. *F Page 2 of 31
ADDRESS
REGISTER
BURST
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AND LOGIC
CLR
Q1
Q0
ENABLE
REGISTER
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OUTPUT
BUFFERS
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REGISTERS
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ARRAY
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A
[1:0]
ZZ
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s
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A
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,
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DQ
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,
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,
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DQ
B
,
DQPB
BYTE
WRITE REGISTER
DQ
A
,
DQPA
BYTE
WRITE REGISTER
Logic Block Diagram – CY7C1361C (256K x 36)
ADDRESS
REGISTER
ADV
CLK
BURST
COUNTER AND
LOGIC
CLR
Q1
Q0
ADSC
CE
1
OE
SENSE
AMPS
MEMORY
ARRAY
ADSP
OUTPUT
BUFFERS
INPUT
REGISTERS
MODE
CE2
CE3
GW
BWE
A
0,A1,A
BW
B
BWA
DQB,DQPB
WRITE REGISTER
DQ
A,DQPA
WRITE REGISTER
ENABLE
REGISTER
A[1:0]
DQs
DQP
A
DQP
B
DQB,DQPB
WRITE DRIVER
DQA,DQPA
WRITE DRIVER
SLEEP
CONTROL
ZZ
Logic Block Diagram – CY7C1363C (512K x 18)
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