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Vancouver Design Center
Interfacing to the Toshiba MIPS TX3912 Processor S1D13505
Issue Date: 01/02/05 X23A-G-010-04
Table of Contents
1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7
2 Interfacing to the TX3912 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8
3 S1D13505 Host Bus Interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9
3.1 TX3912 Host Bus Interface Pin Mapping . . . . . . . . . . . . . . . . . . . . .9
3.2 TX3912 Host Bus Interface Signals . . . . . . . . . . . . . . . . . . . . . . 10
4 Direct Connection to the Toshiba TX3912 . . . . . . . . . . . . . . . . . . . . . . 11
4.1 Hardware Description . . . . . . . . . . . . . . . . . . . . . . . . . . . 11
4.2 S1D13505 Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . 12
4.3 Memory Mapping and Aliasing . . . . . . . . . . . . . . . . . . . . . . . 13
5 System Design Using the IT8368E PC Card Buffer . . . . . . . . . . . . . . . . . . 14
5.1 Hardware Description . . . . . . . . . . . . . . . . . . . . . . . . . . . 14
5.2 IT8368E Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . 15
5.3 S1D13505 Configuration . . . . . . . . . . . . . . . . . . . . . . . . . . 15
6 Software . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16
7 References . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
7.1 Documents . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
7.2 Document Sources . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17
8 Technical Support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18
8.1 EPSON LCD/CRT Controllers (S1D13505) . . . . . . . . . . . . . . . . . . 18
8.2 Toshiba MIPS TX3912 Processor . . . . . . . . . . . . . . . . . . . . . . . 18
8.3 ITE IT8368E . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18